?/p>
1
?/p>
高速数据连接功能简?/p>
10.1.1
高速数据传输的背景
由于现代通信以及各类多媒体技术对带宽的需求迅猛增长,促使一系列基于差分、源同步、时钟数?/p>
恢复?/p>
clock and data recovery
?/p>
CDR
)等先进技术的互连方式应运而生。在传统设计中,单端互连
方式易受干扰、噪声的影响,传输速率最高只能达?/p>
200~250Mbps
?/p>
Line
;在更高速率的接口设?/p>
中,多采用包含有源同步时钟的差分串行传输方式(如
LVDS
?/p>
LVPECL
等),但在传输过程中时钟?/p>
数据分别发送,传输过程中各信号瞬时抖动不一致,破坏了接收数据与时钟之间的定时关系,因而传
输速率很难超越
1Gbps
/通道。因此迫切需要新的高速数据传输技术?/p>
在目前系统级互连速率已达?/p>
Gbps
的设计中,先进的高速串行技术迅速取代传统的并行技术,成为
业界的主流。高速串行技术不仅能够带来更高的性能、更低的成本和更简化的设计,克服了并行的?/p>
度瓶颈,
还节省了
I/O
资源?/p>
使印制板的布线更简单?/p>
因此?/p>
被越来越广泛地应用于各种系统设计中,
包括
PC
、消费电子、海量存储器、服务器、通信网络、工业计算和控制、测试设备等。高速串行传
输一般采用差分线,迄今业界已经发展出了多种串行系统接口标准,例如千兆以太网、万兆以太网?/p>
PCI-Express
、串?/p>
RapidIO
、串?/p>
ATA
等?/p>
10.1.2 Xilinx
公司高速连接功能的解决方案
基于高速的需求和传统技术的弊端?/p>
Xilinx
公司?/p>
Virtex 2 Pro
以及更高系列的部?/p>
FPGA
内部集成?/p>
能实现高速数据收?/p>
Rocket I/O
模块,采用了
CML
?/p>
CurrentMode Logic
)?/p>
CDR
、线路编码(
8B
?/p>
10B
)和预加重等技术的
Rocket I/O
硬核模块,可极大地减小时钟扭曲、信号衰减和线路噪声对接?/p>
性能的影响,从而使传输速率进一步提高,最高可?/p>
10Gbps
以上,可用于实现吉比特以太网?/p>
PCI-Express
等常用接口?/p>
除了底层的物理层技术,
Xilinx
还提供带
32 bit LocalLink
用户接口?/p>
Aurora
协议引擎参考设计?/p>
Aurora
协议是为私有上层协议或标准上层协议提供透明接口的串行互连协议,它允许任何数据分组通过
Aurora
协议封装,并在芯片间电路板间甚至机箱间传输?/p>
Aurora
链路层协议在物理层采用千兆位?/p>
行技术,每物理通道的传输波特率可从
622Mbps
扩展?/p>
3.125 Gbps
?/p>
Aurora
还可?/p>
1
?/p>
16
个物?/p>
通道绑定在一起,形成一?/p>
16
个通道绑定而成的虚拟链路,可提?/p>
50Gbps
的传输波特率和最?/p>
40Gbps
的全双工数据传输速率?/p>
Aurora
可支持广泛的应用范围,如:路由器和交换机、远程接入交
换机?/p>
HDTV
广播系统、分布式服务器和存储子系统。在协议中,每个高速串行链接被称为
?/p>
?/p>
?/p>
?/p>
协议引擎通过与高速收发器配合,可创建?/p>
LocalLink
用户接口逻辑的串并、并串收发器。通过这一
串行接口方案,用户无须自己设计有关串行接口所涉及的编解码、同步、速率匹配等问题。用户接?/p>
部分包含了所有必要的信号,如协议引擎的状态信号等?/p>
Xilinx
通过高品质的技术支持材料来支持其先进的芯片产品,这些材料包括广泛的知识产权核、参?/p>
设计、模拟电路模块、信号完整性(
SI
)设计套件、数字仿真的质量行为模型等。此外,
Xilinx
还提
供了众多设计服务、开发平台以及最佳的
FPGA
实现工具,可确保用户的所有设计需求都能获得最?/p>
产品和技术支持?/p>