电子信息工程学院
课程名称《数字电子技术》复习题
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1
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10
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一、填空题
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每小题△△分,共△△åˆ?/p>
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1
)逻辑代数中的三种基本的逻辑运算是(与)运算ã€?/p>
(或)运算和(非)运算ã€?/p>
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2
)逻辑变量和逻辑函数的取值只有(
0
)和ï¼?/p>
1
)两种取值。它们表示两种相反的逻辑状态ã€?/p>
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3
)与逻辑运算规则可以归纳为有
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,全
1
出(
1
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4
)或逻辑运算规则可以归纳为有
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出(
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5
)与非逻辑运算规则可以归纳为有ï¼?/p>
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)出
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,全ï¼?/p>
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)出
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6
)或非逻辑运算规则可以归纳为有ï¼?/p>
1
)出
0
,全ï¼?/p>
0
)出
1
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7
)二极管从导通到截止所需时间称为(开通)时间ã€?/p>
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8
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OC
门是集电极(开路)门,使用时必须在电源
VCC
与输出端之间外接(电阻)
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9
)在数字电路中,三极管工作在(饱和)状态和(截止)状态ã€?/p>
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10
)三态输出门输出的三个状态分别为(低电平ï¼?/p>
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(高电平ï¼?/p>
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(高阻态)
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11
)逻辑代数中三条重要的规则是(代入)规则、(对偶)规则和(反演)规则ã€?/p>
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12
)化简逻辑函数的主要方法有(代数)化简法和(卡诺图)化简法ã€?/p>
ï¼?/p>
13
)逻辑函数的表示方法主要有(函数表达式)、(真值表)、(逻辑)、卡诺图和波形图ã€?/p>
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31
)编码器按功能不同分为(二进制)编码器、(äº?/p>
-
十进制)编码器和优先编码器ã€?/p>
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32
)译码器按功能不同分为(二进制)译码器、(äº?/p>
-
十进制)译码器和显示译码器ã€?/p>
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33
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8
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1
数据选择器在所有输入数据都ä¸?/p>
1
时,
其输出标准与或表达式共有
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8
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个最小项ã€?/p>
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34
)输å…?/p>
3
位二进制代码的二进制译码器应有(
8
)个输出端,共输出(
8
)个最小项ã€?/p>
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35
)共阳极
LED
数码管应由输出(
ä½?/p>
)电平的七段显示译码器来驱动点亮。而共阴极
LED
数码
管应由输出(
é«?/p>
)电平的七段显示译码器来驱动点亮ã€?/p>
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41
)二进制数是以(
2
)为基数的计数体制,十进制数是以ï¼?/p>
10
)为基数的计数体制,十六
进制是以ï¼?/p>
16
)为计数体制ã€?/p>
ï¼?/p>
42
)十进制数转换为二进制数的方法是:整数部分用(除
2
取余),小数部分用(ä¹?/p>
2
取整)法ã€?/p>
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43
)二进制数转换为十进制数的方法是(各位按权展开相加)ã€?/p>
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44
)全加器有三个输入端,它们分别为(被加数
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加数
)和相邻低位进位;输出端有两个,
分别为本位和、进位数ã€?/p>
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45
)数值比较器的功能是比较两组二进制数的大小或相等的电路,当输å…?/p>
A=1111
å’?/p>
B=1101
时,
则它们比较得结果为(
A>B
)�/p>
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51
)触发器具有两个稳定状态,在外信号作用下这(两个稳定状态)可相互转换ã€?/p>
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52
)边æ²?/p>
JK
触发器具有(ç½?/p>
0
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1
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保持
)和
翻转功能ã€?/p>
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55
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在一ä¸?/p>
CP
脉冲作用下,
引起触发器两次或多次翻转的现象称为触发器的空翻,
触发方式为主
从式或边沿式的触发器不会出现这种现象ã€?/p>
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61
)对于时序逻辑电路来说,某时刻电路的输出状态不仅取决于该时刻的(输入信号),è€?/p>
且还取决电路的(原有状态),因此,时序逻辑电路具有(记忆)性ã€?/p>
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62
)时序逻辑电路由(组合逻辑)电路和(存储)电路两部分组成,(存储)电路必不可少ã€?/p>
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63
)计数器按进制分:有二进制计数器、(
�/p>
)进制计数器和任意进制计数器ã€?/p>
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64
)集成计数器的清零方式分为(异步置零)和(同步置零);置数方式分为(同步置数ï¼?/p>
和(同步置数)ã€?/p>
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65
)一ä¸?/p>
4
位二进制加法计数器的起始计数状æ€?/p>
Q
3
Q
2
Q
1
Q
0
=1010
,当最低位接收åˆ?/p>
4
个计数脉
冲时,输出的ï¼?/p>
1110
)�/p>
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72
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多谐振荡器没æœ?/p>
(稳定)
状态,
只有两个暂稳态状态,
其振荡周æœ?/p>
T
取决äº?/p>
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RC
的值)
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71
)常见的脉冲产生电路æœ?/p>
(
多谐振荡å™?/p>
)
ï¼?/p>
常见的脉冲整形电路有
(单稳态触发器ï¼?/p>
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(施密特è§?/p>
得分
评卷äº?/p>